Comment implémenter l’adresse IP de l’assistant d’horloge dans le projet Vivado

jjsanders

Comment implémenter l’adresse IP de l’assistant d’horloge dans le projet Vivado


J’utilise Vivado (2017.4) et j’ai essayé d’expérimenter l’IP de l’assistant d’horloge. Je comprends comment créer une nouvelle adresse IP mais je ne sais pas quoi faire avec le fichier HDL qu’il génère. J’ai regardé beaucoup de tutoriels et ils semblent tous avoir des méthodes différentes pour incorporer la nouvelle vitesse d’horloge dans leur projet.

Quelqu’un connaît-il une manière standard d’utiliser le code généré par l’assistant d’horloge dans votre projet? Je connais Verilog et VHDL, donc tout conseil serait utile!

Réponses


 Fossette

Dans le fichier HDL généré pour l’assistant de pointage, vous verriez la déclaration d’entité pour l’assistant.

Par exemple:

 entity  clk_wiz_0 port   ( clk_in1 :   in   std_logic , clk_out1 :   out   std_logic 
      ); 
 end  clk_wiz_0 ; 

Ainsi, dans votre code, vous pouvez instancier l’assistant d’horloge en tant que composant.

Exemple:

 component  clk_wiz_0 port   map   ( clk_in1 =>  your_input_clk_signal , clk_out1 =>  your_output_clk_signal ); 
 end   component ; 

Bien qu’il s’agisse d’une méthode, vous pouvez également instancier l’IP dans un diagramme et connecter les signaux d’entrée / sortie de votre assistant dans le diagramme lui-même. Une fois cela fait, vous pouvez laisser Vivado générer les produits de sortie (fichiers VHDL / Verilog pour le diagramme) et créer le fichier wrapper / top level pour vous.

J’espère que cela t’aides


 alex.forencich

Il y a généralement un seul module de niveau supérieur qui aura des broches comme horloge, horloge, réinitialisation, etc. Instanciez simplement cela quelque part dans votre code et connectez les entrées et les sorties de manière appropriée. Consultez le manuel du noyau IP pour une description des broches. Il peut également y avoir un modèle d’instanciation que vous pouvez simplement copier et coller.

 

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